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• 010 __ |a 978-7-5603-3169-0 |d CNY44.00

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• 102 __ |a CN |b 230000

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• 106 __ |a r

• 200 1_ |a Verilog HDL数字系统设计 |A verilog hdl shu zi xi tong she ji |d = Digital design using Verilog HDL |f 王建民, 田晓华, 江晓林编著 |z eng

• 210 __ |a 哈尔滨 |c 哈尔滨工业大学出版社 |d 2011

• 215 __ |a 356页 |c 图 |d 26cm

• 225 2_ |a 电子信息与通信工程系列 |A dian zi xin xi yu tong xin gong cheng xi lie

• 300 __ |a 高等学校“十二五”规划教材

• 320 __ |a 有书目

• 330 __ |a 本书分为11章，内容包括：数字系统设计概述、组合逻辑电路设计回顾、时序逻辑设计回顾、Verilog硬件描述语言等。

• 410 _0 |1 2001 |a 电子信息与通信工程系列

• 510 1_ |a = Digital design using Verilog HDL |z eng

• 606 0_ |a 硬件描述语言 |A ying jian miao shu yu yan |x Verilog HDL |x 程序设计

• 690 __ |a TP312 |v 4

• 701 _0 |a 王建民 |A wang jian min |4 编著

• 701 _0 |a 江晓林 |A jiang xiao lin |4 编著

• 801 _0 |a CN |b 安徽新华 |c 20120523

• 905 __ |a ASTU |d TP312/538

• 915 __ |b 2058655-6 |d TP312 |e 538